Summing Amplifier   가산 증폭기

(2019-03-19)

뎃셈 회로

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  4. 가산 증폭기

1. 가산 증폭기

  ㅇ 각 입력에 대해 가중치 합을 만들어내는 회로


2. 연산증폭기를 사용한 반전증폭기 회로 구성 例

  ㅇ 각 입력 전압귀환 저항(Rf) 및 각 입력 저항(Ri)의 比를 곱한 값들을 더함
     

  ㅇ 구분
     - (가중치 있는 가산기)  
        . 세 입력의 가중치 합을 출력하는 가산기 역할 : vo = - (Rf/R1 v1 + Rf/R2 v2 + Rf/R3 v3)
     - (가중치 없는 가산기)  R1 = R2 = R3 = Rf
        . 세 입력의 단순 합을 출력하는 가산기 역할 : vo = - (v1 + v2 + v3)
     - (평균기)  R1 = R2 = R3 = 3Rf
        . 세 입력의 평균을 출력하는 평균기 역할 : vo = - 1/3 (v1+v2+v3)

  ㅇ 이때의 모든 구성에서, 극성이 반전됨 (parity inverting)


[기초응용회로] 1. 비교기 2. 클리퍼(리미터) 3. 클램퍼 4. 피크 검출기 5. 오차 검출기 6. 정류기 7. 가산 증폭기 8. 미분기/적분기 9. 진상/지상 회로 10. 샘플 홀드 회로
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